mirror of
https://github.com/RIOT-OS/RIOT.git
synced 2024-12-29 04:50:03 +01:00
boards/frdm-kw41z: use common configuration
This commit is contained in:
parent
cb4cdee0ef
commit
151803da5b
@ -1,3 +1,5 @@
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MODULE = board
|
MODULE = board
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||||||
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||||||
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DIRS = $(RIOTBOARD)/common/kw41z
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||||||
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||||||
include $(RIOTBASE)/Makefile.base
|
include $(RIOTBASE)/Makefile.base
|
||||||
|
|||||||
@ -1,7 +1,5 @@
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|||||||
ifneq (,$(filter saul_default,$(USEMODULE)))
|
ifneq (,$(filter saul_default,$(USEMODULE)))
|
||||||
USEMODULE += saul_gpio
|
|
||||||
USEMODULE += saul_adc
|
|
||||||
USEMODULE += fxos8700
|
USEMODULE += fxos8700
|
||||||
endif
|
endif
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||||||
|
|
||||||
include $(RIOTCPU)/kinetis/Makefile.dep
|
include $(RIOTBOARD)/common/kw41z/Makefile.dep
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||||||
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@ -1,13 +1,4 @@
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|||||||
# Put defined MCU peripherals here (in alphabetical order)
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||||||
FEATURES_PROVIDED += periph_adc
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||||||
FEATURES_PROVIDED += periph_i2c
|
FEATURES_PROVIDED += periph_i2c
|
||||||
FEATURES_PROVIDED += periph_rtc
|
|
||||||
FEATURES_PROVIDED += periph_rtt
|
|
||||||
FEATURES_PROVIDED += periph_spi
|
FEATURES_PROVIDED += periph_spi
|
||||||
FEATURES_PROVIDED += periph_timer
|
|
||||||
FEATURES_PROVIDED += periph_uart
|
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||||||
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||||||
# The board MPU family (used for grouping by the CI system)
|
include $(RIOTBOARD)/common/kw41z/Makefile.features
|
||||||
FEATURES_MCU_GROUP = cortex_m0_2
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||||||
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||||||
include $(RIOTCPU)/kinetis/Makefile.features
|
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@ -1,9 +1 @@
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# define the cpu used by the board
|
include $(RIOTBOARD)/common/kw41z/Makefile.include
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||||||
export CPU = kinetis
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||||||
export CPU_MODEL = mkw41z512vht4
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||||||
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||||||
# This board comes with OpenSDA configured for JLink compatibility
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||||||
export DEBUG_ADAPTER ?= jlink
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||||||
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||||||
# Include default FRDM board config
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|
||||||
include $(RIOTBOARD)/common/frdm/Makefile.include
|
|
||||||
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|||||||
@ -1,38 +0,0 @@
|
|||||||
/*
|
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||||||
* Copyright (C) 2017 Eistec AB
|
|
||||||
*
|
|
||||||
* This file is subject to the terms and conditions of the GNU Lesser General
|
|
||||||
* Public License v2.1. See the file LICENSE in the top level directory for more
|
|
||||||
* details.
|
|
||||||
*/
|
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||||||
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|
||||||
/**
|
|
||||||
* @ingroup boards_frdm-kw41z
|
|
||||||
* @{
|
|
||||||
*
|
|
||||||
* @file
|
|
||||||
* @brief Board specific initialization for the FRDM-KW41Z
|
|
||||||
*
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||||||
* @author Joakim Nohlgård <joakim.nohlgard@eistec.se>
|
|
||||||
*
|
|
||||||
* @}
|
|
||||||
*/
|
|
||||||
|
|
||||||
#include "board.h"
|
|
||||||
#include "periph/gpio.h"
|
|
||||||
|
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||||||
void board_init(void)
|
|
||||||
{
|
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/* initialize the CPU core */
|
|
||||||
cpu_init();
|
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||||||
|
|
||||||
/* initialize and turn off LEDs */
|
|
||||||
gpio_init(LED0_PIN, GPIO_OUT);
|
|
||||||
gpio_set(LED0_PIN);
|
|
||||||
gpio_init(LED1_PIN, GPIO_OUT);
|
|
||||||
gpio_set(LED1_PIN);
|
|
||||||
gpio_init(LED2_PIN, GPIO_OUT);
|
|
||||||
gpio_set(LED2_PIN);
|
|
||||||
gpio_init(LED3_PIN, GPIO_OUT);
|
|
||||||
gpio_set(LED3_PIN);
|
|
||||||
}
|
|
||||||
@ -20,6 +20,7 @@
|
|||||||
#define BOARD_H
|
#define BOARD_H
|
||||||
|
|
||||||
#include "cpu.h"
|
#include "cpu.h"
|
||||||
|
#include "board_common.h"
|
||||||
#include "periph_conf.h"
|
#include "periph_conf.h"
|
||||||
|
|
||||||
#ifdef __cplusplus
|
#ifdef __cplusplus
|
||||||
@ -106,11 +107,6 @@ extern "C"
|
|||||||
#define FXOS8700_PARAM_ADDR 0x1F
|
#define FXOS8700_PARAM_ADDR 0x1F
|
||||||
/** @} */
|
/** @} */
|
||||||
|
|
||||||
/**
|
|
||||||
* @brief Initialize board specific hardware, including clock, LEDs and standard I/O
|
|
||||||
*/
|
|
||||||
void board_init(void);
|
|
||||||
|
|
||||||
#ifdef __cplusplus
|
#ifdef __cplusplus
|
||||||
}
|
}
|
||||||
#endif
|
#endif
|
||||||
|
|||||||
@ -20,6 +20,8 @@
|
|||||||
#define PERIPH_CONF_H
|
#define PERIPH_CONF_H
|
||||||
|
|
||||||
#include "periph_cpu.h"
|
#include "periph_cpu.h"
|
||||||
|
#include "periph_conf_common.h"
|
||||||
|
#include "cfg_i2c_default.h"
|
||||||
|
|
||||||
#ifdef __cplusplus
|
#ifdef __cplusplus
|
||||||
extern "C"
|
extern "C"
|
||||||
@ -27,99 +29,42 @@ extern "C"
|
|||||||
#endif
|
#endif
|
||||||
|
|
||||||
/**
|
/**
|
||||||
* @name Clock system configuration
|
* @name SPI configuration
|
||||||
* @{
|
* @{
|
||||||
*/
|
*/
|
||||||
static const clock_config_t clock_config = {
|
static const spi_conf_t spi_config[] = {
|
||||||
/*
|
|
||||||
* This configuration results in the system running with the internal clock
|
|
||||||
* with the following clock frequencies:
|
|
||||||
* Core: 48 MHz
|
|
||||||
* Bus: 24 MHz
|
|
||||||
* Flash: 24 MHz
|
|
||||||
*/
|
|
||||||
.clkdiv1 = SIM_CLKDIV1_OUTDIV1(0) | SIM_CLKDIV1_OUTDIV4(1),
|
|
||||||
/* unsure if this RTC load cap configuration is correct, but it matches the
|
|
||||||
* settings used by the example code in the NXP provided SDK */
|
|
||||||
.rtc_clc = 0,
|
|
||||||
/* Use the 32 kHz oscillator as ERCLK32K. Note that the values here have a
|
|
||||||
* different mapping for the KW41Z than the values used in the Kinetis K series */
|
|
||||||
.osc32ksel = SIM_SOPT1_OSC32KSEL(0),
|
|
||||||
.clock_flags =
|
|
||||||
KINETIS_CLOCK_OSC0_EN | /* Enable RSIM oscillator */
|
|
||||||
KINETIS_CLOCK_RTCOSC_EN |
|
|
||||||
KINETIS_CLOCK_USE_FAST_IRC |
|
|
||||||
KINETIS_CLOCK_MCGIRCLK_EN | /* Used for LPUART clocking */
|
|
||||||
KINETIS_CLOCK_MCGIRCLK_STOP_EN |
|
|
||||||
0,
|
|
||||||
/* Using FEI mode by default, the external crystal settings below are only
|
|
||||||
* used if mode is changed to an external mode (PEE, FBE, or FEE) */
|
|
||||||
.default_mode = KINETIS_MCG_MODE_FEI,
|
|
||||||
/* The crystal connected to RSIM OSC is 32 MHz */
|
|
||||||
.erc_range = KINETIS_MCG_ERC_RANGE_VERY_HIGH,
|
|
||||||
.osc_clc = 0, /* no load cap configuration */
|
|
||||||
.oscsel = MCG_C7_OSCSEL(0), /* Use RSIM for external clock */
|
|
||||||
.fcrdiv = MCG_SC_FCRDIV(0), /* Fast IRC divide by 1 => 4 MHz */
|
|
||||||
.fll_frdiv = MCG_C1_FRDIV(0b101), /* Divide by 1024 */
|
|
||||||
.fll_factor_fei = KINETIS_MCG_FLL_FACTOR_1464, /* FEI FLL freq = 48 MHz */
|
|
||||||
.fll_factor_fee = KINETIS_MCG_FLL_FACTOR_1280, /* FEE FLL freq = 40 MHz */
|
|
||||||
};
|
|
||||||
/* Radio xtal frequency, either 32 MHz or 26 MHz */
|
|
||||||
#define CLOCK_RADIOXTAL (32000000ul)
|
|
||||||
/* CPU core clock, the MCG clock output frequency */
|
|
||||||
#define CLOCK_CORECLOCK (48000000ul)
|
|
||||||
#define CLOCK_BUSCLOCK (CLOCK_CORECLOCK / 2)
|
|
||||||
#define CLOCK_MCGIRCLK (4000000ul)
|
|
||||||
/** @} */
|
|
||||||
|
|
||||||
/**
|
|
||||||
* @name Timer configuration
|
|
||||||
* @{
|
|
||||||
*/
|
|
||||||
#define PIT_NUMOF (1U)
|
|
||||||
#define PIT_CONFIG { \
|
|
||||||
{ \
|
|
||||||
.prescaler_ch = 0, \
|
|
||||||
.count_ch = 1, \
|
|
||||||
}, \
|
|
||||||
}
|
|
||||||
#define LPTMR_NUMOF (1U)
|
|
||||||
#define LPTMR_CONFIG { \
|
|
||||||
{ \
|
|
||||||
.dev = LPTMR0, \
|
|
||||||
.irqn = LPTMR0_IRQn, \
|
|
||||||
.src = 2, \
|
|
||||||
.base_freq = 32768u, \
|
|
||||||
} \
|
|
||||||
}
|
|
||||||
#define TIMER_NUMOF ((PIT_NUMOF) + (LPTMR_NUMOF))
|
|
||||||
#define PIT_BASECLOCK (CLOCK_BUSCLOCK)
|
|
||||||
#define LPTMR_ISR_0 isr_lptmr0
|
|
||||||
/** @} */
|
|
||||||
|
|
||||||
/**
|
|
||||||
* @name UART configuration
|
|
||||||
* @{
|
|
||||||
*/
|
|
||||||
static const uart_conf_t uart_config[] = {
|
|
||||||
{
|
{
|
||||||
.dev = LPUART0,
|
.dev = SPI0,
|
||||||
.freq = CLOCK_MCGIRCLK,
|
.pin_miso = GPIO_PIN(PORT_C, 18),
|
||||||
.pin_rx = GPIO_PIN(PORT_C, 6),
|
.pin_mosi = GPIO_PIN(PORT_C, 17),
|
||||||
.pin_tx = GPIO_PIN(PORT_C, 7),
|
.pin_clk = GPIO_PIN(PORT_C, 16),
|
||||||
.pcr_rx = PORT_PCR_MUX(4),
|
.pin_cs = {
|
||||||
.pcr_tx = PORT_PCR_MUX(4),
|
GPIO_PIN(PORT_C, 19),
|
||||||
.irqn = LPUART0_IRQn,
|
GPIO_UNDEF,
|
||||||
.scgc_addr = &SIM->SCGC5,
|
GPIO_UNDEF,
|
||||||
.scgc_bit = SIM_SCGC5_LPUART0_SHIFT,
|
GPIO_UNDEF,
|
||||||
.mode = UART_MODE_8N1,
|
GPIO_UNDEF
|
||||||
.type = KINETIS_LPUART,
|
},
|
||||||
|
.pcr = GPIO_AF_2,
|
||||||
|
.simmask = SIM_SCGC6_SPI0_MASK
|
||||||
},
|
},
|
||||||
|
{
|
||||||
|
.dev = SPI1,
|
||||||
|
.pin_miso = GPIO_PIN(PORT_A, 17),
|
||||||
|
.pin_mosi = GPIO_PIN(PORT_A, 16),
|
||||||
|
.pin_clk = GPIO_PIN(PORT_A, 18),
|
||||||
|
.pin_cs = {
|
||||||
|
GPIO_PIN(PORT_A, 19),
|
||||||
|
GPIO_UNDEF,
|
||||||
|
GPIO_UNDEF,
|
||||||
|
GPIO_UNDEF,
|
||||||
|
GPIO_UNDEF
|
||||||
|
},
|
||||||
|
.pcr = GPIO_AF_2,
|
||||||
|
.simmask = SIM_SCGC6_SPI1_MASK
|
||||||
|
}
|
||||||
};
|
};
|
||||||
#define UART_NUMOF (sizeof(uart_config) / sizeof(uart_config[0]))
|
#define SPI_NUMOF (sizeof(spi_config) / sizeof(spi_config[0]))
|
||||||
#define LPUART_0_ISR isr_lpuart0
|
|
||||||
/* Use MCGIRCLK (internal reference 4 MHz clock) */
|
|
||||||
#define LPUART_0_SRC 3
|
|
||||||
/** @} */
|
/** @} */
|
||||||
|
|
||||||
/**
|
/**
|
||||||
@ -161,112 +106,6 @@ static const adc_conf_t adc_config[] = {
|
|||||||
#define ADC_REF_SETTING 1
|
#define ADC_REF_SETTING 1
|
||||||
/** @} */
|
/** @} */
|
||||||
|
|
||||||
/**
|
|
||||||
* @name SPI configuration
|
|
||||||
*
|
|
||||||
* Clock configuration values based on the configured 16Mhz module clock.
|
|
||||||
*
|
|
||||||
* Auto-generated by:
|
|
||||||
* cpu/kinetis/dist/calc_spi_scalers/calc_spi_scalers.c
|
|
||||||
*
|
|
||||||
* @{
|
|
||||||
*/
|
|
||||||
static const uint32_t spi_clk_config[] = {
|
|
||||||
(
|
|
||||||
SPI_CTAR_PBR(2) | SPI_CTAR_BR(5) | /* -> 100000Hz */
|
|
||||||
SPI_CTAR_PCSSCK(2) | SPI_CTAR_CSSCK(4) |
|
|
||||||
SPI_CTAR_PASC(2) | SPI_CTAR_ASC(4) |
|
|
||||||
SPI_CTAR_PDT(2) | SPI_CTAR_DT(4)
|
|
||||||
),
|
|
||||||
(
|
|
||||||
SPI_CTAR_PBR(2) | SPI_CTAR_BR(3) | /* -> 400000Hz */
|
|
||||||
SPI_CTAR_PCSSCK(2) | SPI_CTAR_CSSCK(2) |
|
|
||||||
SPI_CTAR_PASC(2) | SPI_CTAR_ASC(2) |
|
|
||||||
SPI_CTAR_PDT(2) | SPI_CTAR_DT(2)
|
|
||||||
),
|
|
||||||
(
|
|
||||||
SPI_CTAR_PBR(0) | SPI_CTAR_BR(3) | /* -> 1000000Hz */
|
|
||||||
SPI_CTAR_PCSSCK(0) | SPI_CTAR_CSSCK(3) |
|
|
||||||
SPI_CTAR_PASC(0) | SPI_CTAR_ASC(3) |
|
|
||||||
SPI_CTAR_PDT(0) | SPI_CTAR_DT(3)
|
|
||||||
),
|
|
||||||
(
|
|
||||||
SPI_CTAR_PBR(0) | SPI_CTAR_BR(0) | /* -> 4000000Hz */
|
|
||||||
SPI_CTAR_PCSSCK(0) | SPI_CTAR_CSSCK(1) |
|
|
||||||
SPI_CTAR_PASC(0) | SPI_CTAR_ASC(1) |
|
|
||||||
SPI_CTAR_PDT(0) | SPI_CTAR_DT(1)
|
|
||||||
),
|
|
||||||
(
|
|
||||||
SPI_CTAR_PBR(0) | SPI_CTAR_BR(0) | /* -> 4000000Hz */
|
|
||||||
SPI_CTAR_PCSSCK(0) | SPI_CTAR_CSSCK(0) |
|
|
||||||
SPI_CTAR_PASC(0) | SPI_CTAR_ASC(0) |
|
|
||||||
SPI_CTAR_PDT(0) | SPI_CTAR_DT(0)
|
|
||||||
)
|
|
||||||
};
|
|
||||||
|
|
||||||
static const spi_conf_t spi_config[] = {
|
|
||||||
{
|
|
||||||
.dev = SPI0,
|
|
||||||
.pin_miso = GPIO_PIN(PORT_C, 18),
|
|
||||||
.pin_mosi = GPIO_PIN(PORT_C, 17),
|
|
||||||
.pin_clk = GPIO_PIN(PORT_C, 16),
|
|
||||||
.pin_cs = {
|
|
||||||
GPIO_PIN(PORT_C, 19),
|
|
||||||
GPIO_UNDEF,
|
|
||||||
GPIO_UNDEF,
|
|
||||||
GPIO_UNDEF,
|
|
||||||
GPIO_UNDEF
|
|
||||||
},
|
|
||||||
.pcr = GPIO_AF_2,
|
|
||||||
.simmask = SIM_SCGC6_SPI0_MASK
|
|
||||||
},
|
|
||||||
{
|
|
||||||
.dev = SPI1,
|
|
||||||
.pin_miso = GPIO_PIN(PORT_A, 17),
|
|
||||||
.pin_mosi = GPIO_PIN(PORT_A, 16),
|
|
||||||
.pin_clk = GPIO_PIN(PORT_A, 18),
|
|
||||||
.pin_cs = {
|
|
||||||
GPIO_PIN(PORT_A, 19),
|
|
||||||
GPIO_UNDEF,
|
|
||||||
GPIO_UNDEF,
|
|
||||||
GPIO_UNDEF,
|
|
||||||
GPIO_UNDEF
|
|
||||||
},
|
|
||||||
.pcr = GPIO_AF_2,
|
|
||||||
.simmask = SIM_SCGC6_SPI1_MASK
|
|
||||||
}
|
|
||||||
};
|
|
||||||
#define SPI_NUMOF (sizeof(spi_config) / sizeof(spi_config[0]))
|
|
||||||
/** @} */
|
|
||||||
|
|
||||||
|
|
||||||
/**
|
|
||||||
* @name I2C configuration
|
|
||||||
* @{
|
|
||||||
*/
|
|
||||||
static const i2c_conf_t i2c_config[] = {
|
|
||||||
{
|
|
||||||
.i2c = I2C1,
|
|
||||||
.scl_pin = GPIO_PIN(PORT_C, 2),
|
|
||||||
.sda_pin = GPIO_PIN(PORT_C, 3),
|
|
||||||
.freq = CLOCK_CORECLOCK,
|
|
||||||
.speed = I2C_SPEED_FAST,
|
|
||||||
.irqn = I2C1_IRQn,
|
|
||||||
.scl_pcr = (PORT_PCR_MUX(3)),
|
|
||||||
.sda_pcr = (PORT_PCR_MUX(3)),
|
|
||||||
},
|
|
||||||
};
|
|
||||||
#define I2C_NUMOF (sizeof(i2c_config) / sizeof(i2c_config[0]))
|
|
||||||
#define I2C_0_ISR (isr_i2c1)
|
|
||||||
/** @} */
|
|
||||||
|
|
||||||
/**
|
|
||||||
* @name Random Number Generator configuration
|
|
||||||
* @{
|
|
||||||
*/
|
|
||||||
#define KINETIS_TRNG TRNG
|
|
||||||
/** @} */
|
|
||||||
|
|
||||||
#ifdef __cplusplus
|
#ifdef __cplusplus
|
||||||
}
|
}
|
||||||
#endif
|
#endif
|
||||||
|
|||||||
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